SRラッチはどのように機能しますか?

SR ラッチ (基本 RS フリップフロップとも呼ばれます) は、さまざまなフリップフロップ回路の中で最も単純な構造形式であり、同時に TA もその 1 つです。多くの複雑な回路からなる構造トリガーの基本的な構成要素。 (推奨調査: phpstorm)

RS ラッチは、1 つまたは 2 つの入力と 2 つの出力を備えた回路です。この回路は、次の図 a に示すとおりです。フィードバック接続された 2 つの NAND ゲートで構成され、その 2 つの出力は反対の 2 つの出力 (または相補出力と呼ばれます) であり、図 b にその論理記号を示します。

#図では、/RD と /SD は RS ラッチの 2 つの入力端子、Q と /Q は 2 つの相補出力です。 /RD と /SD がハイ レベルのときは出力状態は変化しませんが、入力の 1 つがロー レベルのときのみ出力が変化することがわかります。そのため、/RD と /SD はアクティブ ロー レベルになります。

RS ラッチの動作プロセスを見てみましょう。これは 4 つの状況で説明できます:

1. /RD=0, / SD=0

この回路から、/RD=0、/SD=0、Q=/Q=1 のとき、ラッチされた Q と /Q は 2 つの相補出力であることがわかります。 2 つの出力が等しくなり、これは許可されません。したがって、この状況はラッチにとって許可されないため、通常は許可されない状態と呼ばれます;

#2./RD=0,/SD =1

/SD=1 であるため、Q の状態は /Q の状態に依存し、/RD=0,/Q=1 であるため、Q=0 であるため、/RD の場合=0,/SD=1、フリップフロップは 0 に設定されるため、セット 0 状態と呼ばれます;

3./RD=1,/SD= 0

これは前の状況とはまったく逆です。Q=1,/Q=0、つまりフリップフロップが 1 にセットされているため、セット状態と呼ばれます。

4./RD=1,/SD=1

RS の入力はアクティブ ロー レベルであり、両方の入力がハイ レベルであるため、出力状態は変化しません。保持状態といいます。

上記のRSラッチはNANDで構成されていますが、NORゲートを用いてRSラッチを構成することもでき、RSラッチの機能も実現できます。

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